/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ /* * Copyright (c) 2023, Qualcomm Innovation Center, Inc. All rights reserved. * Copyright (c) 2025, Luca Weiss <luca.weiss@fairphone.com> */ #ifndef _DT_BINDINGS_CLK_QCOM_GCC_MILOS_H #define _DT_BINDINGS_CLK_QCOM_GCC_MILOS_H /* GCC clocks */ #define GCC_GPLL0 0 #define GCC_GPLL0_OUT_EVEN 1 #define GCC_GPLL2 2 #define GCC_GPLL4 3 #define GCC_GPLL6 4 #define GCC_GPLL7 5 #define GCC_GPLL9 6 #define GCC_AGGRE_NOC_PCIE_AXI_CLK 7 #define GCC_AGGRE_UFS_PHY_AXI_CLK 8 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK 9 #define GCC_AGGRE_USB3_PRIM_AXI_CLK 10 #define GCC_BOOT_ROM_AHB_CLK 11 #define GCC_CAMERA_AHB_CLK 12 #define GCC_CAMERA_HF_AXI_CLK 13 #define GCC_CAMERA_HF_XO_CLK 14 #define GCC_CAMERA_SF_AXI_CLK 15 #define GCC_CAMERA_SF_XO_CLK 16 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK 17 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK 18 #define GCC_CNOC_PCIE_SF_AXI_CLK 19 #define GCC_DDRSS_GPU_AXI_CLK 20 #define GCC_DDRSS_PCIE_SF_QTB_CLK 21 #define GCC_DISP_AHB_CLK 22 #define GCC_DISP_GPLL0_DIV_CLK_SRC 23 #define GCC_DISP_HF_AXI_CLK 24 #define GCC_DISP_XO_CLK 25 #define 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