/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ /* * Copyright (c) 2024, Qualcomm Innovation Center, Inc. All rights reserved. */ #ifndef _DT_BINDINGS_CLK_QCOM_GCC_SM8750_H #define _DT_BINDINGS_CLK_QCOM_GCC_SM8750_H /* GCC clocks */ #define GCC_AGGRE_NOC_PCIE_AXI_CLK 0 #define GCC_AGGRE_UFS_PHY_AXI_CLK 1 #define GCC_AGGRE_UFS_PHY_AXI_HW_CTL_CLK 2 #define GCC_AGGRE_USB3_PRIM_AXI_CLK 3 #define GCC_BOOT_ROM_AHB_CLK 4 #define GCC_CAM_BIST_MCLK_AHB_CLK 5 #define GCC_CAMERA_AHB_CLK 6 #define GCC_CAMERA_HF_AXI_CLK 7 #define GCC_CAMERA_SF_AXI_CLK 8 #define GCC_CAMERA_XO_CLK 9 #define GCC_CFG_NOC_PCIE_ANOC_AHB_CLK 10 #define GCC_CFG_NOC_USB3_PRIM_AXI_CLK 11 #define GCC_CNOC_PCIE_SF_AXI_CLK 12 #define GCC_DDRSS_GPU_AXI_CLK 13 #define GCC_DDRSS_PCIE_SF_QTB_CLK 14 #define GCC_DISP_AHB_CLK 15 #define GCC_DISP_HF_AXI_CLK 16 #define GCC_EVA_AHB_CLK 17 #define GCC_EVA_AXI0_CLK 18 #define GCC_EVA_AXI0C_CLK 19 #define GCC_EVA_XO_CLK 20 #define GCC_GP1_CLK 21 #define GCC_GP1_CLK_SRC 22 #define GCC_GP2_CLK 23 #define GCC_GP2_CLK_SRC 24 #define GCC_GP3_CLK 25 #define GCC_GP3_CLK_SRC 26 #define GCC_GPLL0 27 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17 #define GCC_QUSB2PHY_SEC_BCR 18 #define GCC_SDCC2_BCR 19 #define GCC_SDCC4_BCR 20 #define GCC_UFS_PHY_BCR 21 #define GCC_USB30_PRIM_BCR 22 #define GCC_USB3_DP_PHY_PRIM_BCR 23 #define GCC_USB3_DP_PHY_SEC_BCR 24 #define GCC_USB3_PHY_PRIM_BCR 25 #define GCC_USB3_PHY_SEC_BCR 26 #define GCC_USB3PHY_PHY_PRIM_BCR 27 #define GCC_USB3PHY_PHY_SEC_BCR 28 #define GCC_VIDEO_AXI0_CLK_ARES 29 #define GCC_VIDEO_AXI1_CLK_ARES 30 #define GCC_VIDEO_BCR 31 #define GCC_EVA_AXI0_CLK_ARES 32 #define GCC_EVA_AXI0C_CLK_ARES 33 #endif
