/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */ /* * Copyright (C) 2024 Ivaylo Ivanov <ivo.ivanov.ivanov1@gmail.com> * Author: Ivaylo Ivanov <ivo.ivanov.ivanov1@gmail.com> * * Device Tree binding constants for Exynos8895 clock controller. */ #ifndef _DT_BINDINGS_CLOCK_EXYNOS8895_H #define _DT_BINDINGS_CLOCK_EXYNOS8895_H /* CMU_TOP */ #define CLK_FOUT_SHARED0_PLL 1 #define CLK_FOUT_SHARED1_PLL 2 #define CLK_FOUT_SHARED2_PLL 3 #define CLK_FOUT_SHARED3_PLL 4 #define CLK_FOUT_SHARED4_PLL 5 #define CLK_MOUT_PLL_SHARED0 6 #define CLK_MOUT_PLL_SHARED1 7 #define CLK_MOUT_PLL_SHARED2 8 #define CLK_MOUT_PLL_SHARED3 9 #define CLK_MOUT_PLL_SHARED4 10 #define CLK_MOUT_CP2AP_MIF_CLK_USER 11 #define CLK_MOUT_CMU_ABOX_CPUABOX 12 #define CLK_MOUT_CMU_APM_BUS 13 #define CLK_MOUT_CMU_BUS1_BUS 14 #define CLK_MOUT_CMU_BUSC_BUS 15 #define CLK_MOUT_CMU_BUSC_BUSPHSI2C 16 #define CLK_MOUT_CMU_CAM_BUS 17 #define CLK_MOUT_CMU_CAM_TPU0 18 #define CLK_MOUT_CMU_CAM_TPU1 19 #define CLK_MOUT_CMU_CAM_VRA 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