IP10_31_28
PINMUX_IPSR_MSEL(IP10_31_28, SCL1_A, SEL_I2C01_0),
PINMUX_IPSR_MSEL(IP10_31_28, RX4_A, SEL_SCIF4_0),
PINMUX_IPSR_GPSR(IP10_31_28, PWM5_D),
PINMUX_IPSR_GPSR(IP10_31_28, DU1_DR0),
PINMUX_IPSR_MSEL(IP10_31_28, SSI_SCK6_B, SEL_SSI6_1),
PINMUX_IPSR_GPSR(IP10_31_28, VI0_G0),
PINMUX_IPSR_GPSR(IP10_31_28, SD3_DAT6),
PINMUX_IPSR_GPSR(IP10_31_28, SD3_CD),
PINMUX_IPSR_GPSR(IP10_31_28, NFDATA6),
#define GPSR4_15 F_(SD3_DAT6, IP10_31_28)
FM(IP8_31_28) IP8_31_28 FM(IP9_31_28) IP9_31_28 FM(IP10_31_28) IP10_31_28 FM(IP11_31_28) IP11_31_28 \
IP10_31_28
PINMUX_IPSR_GPSR(IP10_31_28, SD3_DAT6),
PINMUX_IPSR_GPSR(IP10_31_28, SD3_CD),
PINMUX_IPSR_GPSR(IP10_31_28, NFDATA6),
#define GPSR4_15 F_(SD3_DAT6, IP10_31_28)
FM(IP8_31_28) IP8_31_28 FM(IP9_31_28) IP9_31_28 FM(IP10_31_28) IP10_31_28 FM(IP11_31_28) IP11_31_28 \
IP10_31_28
PINMUX_IPSR_GPSR(IP10_31_28, SD3_DAT6),
PINMUX_IPSR_GPSR(IP10_31_28, SD3_CD),
PINMUX_IPSR_GPSR(IP10_31_28, NFDATA6),
#define GPSR4_15 F_(SD3_DAT6, IP10_31_28)
FM(IP8_31_28) IP8_31_28 FM(IP9_31_28) IP9_31_28 FM(IP10_31_28) IP10_31_28 FM(IP11_31_28) IP11_31_28 \
IP10_31_28
PINMUX_IPSR_GPSR(IP10_31_28, SD0_WP),
PINMUX_IPSR_MSEL(IP10_31_28, NFRB_N_A, SEL_NDF_0),
PINMUX_IPSR_GPSR(IP10_31_28, SD3_WP),
PINMUX_IPSR_MSEL(IP10_31_28, RIF0_D0_B, SEL_DRIF0_1),
PINMUX_IPSR_MSEL(IP10_31_28, SDA2_B, SEL_I2C2_1),
PINMUX_IPSR_MSEL(IP10_31_28, TCLK2_A, SEL_TIMER_TMU_0),
PINMUX_IPSR_MSEL(IP10_31_28, SSI_WS2_B, SEL_SSI2_1),
PINMUX_IPSR_GPSR(IP10_31_28, TS_SDAT0),
#define GPSR3_13 F_(SD0_WP, IP10_31_28)
FM(IP8_31_28) IP8_31_28 FM(IP9_31_28) IP9_31_28 FM(IP10_31_28) IP10_31_28 FM(IP11_31_28) IP11_31_28 \
IP10_31_28
#define GPSR4_10 F_(SCL1, IP10_31_28)
IP10_31_28
FM(IP8_31_28) IP8_31_28 FM(IP9_31_28) IP9_31_28 FM(IP10_31_28) IP10_31_28 FM(IP11_31_28) IP11_31_28 \
PINMUX_IPSR_GPSR(IP10_31_28, SCL1),
PINMUX_IPSR_GPSR(IP10_31_28, CTS1_N),