IP10_27_24
PINMUX_IPSR_MSEL(IP10_27_24, SDA0_A, SEL_I2C00_0),
PINMUX_IPSR_MSEL(IP10_27_24, TX0_C, SEL_SCIF0_2),
PINMUX_IPSR_GPSR(IP10_27_24, IRQ5),
PINMUX_IPSR_MSEL(IP10_27_24, CAN_CLK_A, SEL_CANCLK_0),
PINMUX_IPSR_GPSR(IP10_27_24, AVB_GTX_CLK),
PINMUX_IPSR_MSEL(IP10_27_24, CAN1_TX_D, SEL_CAN1_3),
PINMUX_IPSR_GPSR(IP10_27_24, DVC_MUTE),
PINMUX_IPSR_GPSR(IP10_27_24, SD3_DAT5),
PINMUX_IPSR_MSEL(IP10_27_24, SD2_WP_A, SEL_SDHI2_0),
PINMUX_IPSR_GPSR(IP10_27_24, NFDATA5),
#define GPSR4_14 F_(SD3_DAT5, IP10_27_24)
FM(IP8_27_24) IP8_27_24 FM(IP9_27_24) IP9_27_24 FM(IP10_27_24) IP10_27_24 FM(IP11_27_24) IP11_27_24 \
IP10_27_24
PINMUX_IPSR_GPSR(IP10_27_24, SD3_DAT5),
PINMUX_IPSR_MSEL(IP10_27_24, SD2_WP_A, SEL_SDHI2_0),
PINMUX_IPSR_GPSR(IP10_27_24, NFDATA5),
#define GPSR4_14 F_(SD3_DAT5, IP10_27_24)
FM(IP8_27_24) IP8_27_24 FM(IP9_27_24) IP9_27_24 FM(IP10_27_24) IP10_27_24 FM(IP11_27_24) IP11_27_24 \
IP10_27_24
PINMUX_IPSR_GPSR(IP10_27_24, SD3_DAT5),
PINMUX_IPSR_MSEL(IP10_27_24, SD2_WP_A, SEL_SDHI2_0),
PINMUX_IPSR_GPSR(IP10_27_24, NFDATA5),
#define GPSR4_14 F_(SD3_DAT5, IP10_27_24)
FM(IP8_27_24) IP8_27_24 FM(IP9_27_24) IP9_27_24 FM(IP10_27_24) IP10_27_24 FM(IP11_27_24) IP11_27_24 \
IP10_27_24
PINMUX_IPSR_GPSR(IP10_27_24, SD0_CD),
PINMUX_IPSR_MSEL(IP10_27_24, NFALE_A, SEL_NDF_0),
PINMUX_IPSR_GPSR(IP10_27_24, SD3_CD),
PINMUX_IPSR_MSEL(IP10_27_24, RIF0_CLK_B, SEL_DRIF0_1),
PINMUX_IPSR_MSEL(IP10_27_24, SCL2_B, SEL_I2C2_1),
PINMUX_IPSR_MSEL(IP10_27_24, TCLK1_A, SEL_TIMER_TMU_0),
PINMUX_IPSR_MSEL(IP10_27_24, SSI_SCK2_B, SEL_SSI2_1),
PINMUX_IPSR_GPSR(IP10_27_24, TS_SCK0),
#define GPSR3_12 F_(SD0_CD, IP10_27_24)
FM(IP8_27_24) IP8_27_24 FM(IP9_27_24) IP9_27_24 FM(IP10_27_24) IP10_27_24 FM(IP11_27_24) IP11_27_24 \
IP10_27_24
#define GPSR4_7 F_(SSI_WS4_A, IP10_27_24)
IP10_27_24
FM(IP8_27_24) IP8_27_24 FM(IP9_27_24) IP9_27_24 FM(IP10_27_24) IP10_27_24 FM(IP11_27_24) IP11_27_24 \
PINMUX_IPSR_MSEL(IP10_27_24, SSI_WS4_A, SEL_SSIF4_0),
PINMUX_IPSR_GPSR(IP10_27_24, HRX0),
PINMUX_IPSR_MSEL(IP10_27_24, SDA2_A, SEL_I2C2_0),
PINMUX_IPSR_MSEL(IP10_27_24, CAN1_TX_B, SEL_CAN1_1),