F2
#define F2(X, Y) (OP(X) | OP2(Y))
#define F2(X, Y) (OP(X) | OP2(Y))
#define F2(D, m, r) ((I = ((m) ^ (D))), (I = rol32(I, (r))), \
#define F2(D, r, m) ((I = ((m) ^ (D))), (I = rol32(I, (r))), \
#define F2(x, y, z) (z ^ (x & (y ^ z))) /* x ? y : z */
#define F2 184
#define F2(a) a##_MARK
F1(LCDHSYN), F2(LCDCS), F3(SCIFB1_RTS_24),
F1(LCDDCK), F2(LCDWR), F3(SCIFB1_TXD_26), F7(DU0_DOTCLKIN),
F1(LCDDISP), F2(LCDRS), F3(SCIFB1_RXD_27), F7(DU0_DOTCLKOUT),
F1(HSI_RX_WAKE), F2(SCIFB2_CTS_66), F3(MSIOF3_SYNC), F5(GenIO4),
F1(HSI_RX_READY), F2(SCIFB1_TXD_67), F5(GIO_OUT3_67), F7(CHSCIF1_HTX),
F1(HSI_RX_FLAG), F2(SCIFB2_TXD_68), F3(MSIOF3_TXD), F5(GIO_OUT4_68),
F1(HSI_RX_DATA), F2(SCIFB2_RXD_69), F3(MSIOF3_RXD), F5(GIO_OUT5_69),
F1(HSI_TX_FLAG), F2(SCIFB1_RTS_70), F5(GIO_OUT1_70), F6(HSIC_TSTCLK0),
F1(HSI_TX_DATA), F2(SCIFB1_CTS_71), F5(GIO_OUT2_71), F6(HSIC_TSTCLK1),
F1(HSI_TX_WAKE), F2(SCIFB1_RXD_72), F5(GenIO8), F7(CHSCIF1_HRX),
F1(HSI_TX_READY), F2(SCIFB2_RTS_73), F3(MSIOF3_SCK), F5(GIO_OUT0_73),
F2(KEYOUT0), F2(KEYOUT1), F2(KEYOUT2), F2(KEYOUT3),
F2(KEYOUT0), F2(KEYOUT1), F2(KEYOUT2), F2(KEYOUT3),
F2(KEYOUT0), F2(KEYOUT1), F2(KEYOUT2), F2(KEYOUT3),
F2(KEYOUT0), F2(KEYOUT1), F2(KEYOUT2), F2(KEYOUT3),
F2(KEYOUT4), F2(KEYOUT5), IRQ(43), F2(KEYOUT6), IRQ(44), /* Port110 */
F2(KEYOUT4), F2(KEYOUT5), IRQ(43), F2(KEYOUT6), IRQ(44), /* Port110 */
F2(KEYOUT4), F2(KEYOUT5), IRQ(43), F2(KEYOUT6), IRQ(44), /* Port110 */
F2(KEYOUT7), F5(RFANAEN), IRQ(45),
F1(KEYIN8), F2(KEYOUT8), F4(SF_IRQ_04), IRQ(46),
F1(KEYIN9), F2(KEYOUT9), F4(SF_IRQ_05), IRQ(47),
F1(KEYIN10), F2(KEYOUT10), F4(SF_IRQ_06), IRQ(48),
F1(KEYIN11), F2(KEYOUT11), F4(SF_IRQ_07), IRQ(49),
F1(STP_ISD_0), F2(PDM4_CLK_125), F3(MSIOF2_TXD), F5(SIM0_VOLTSEL0),
F1(TS_SDEN), F2(MSIOF7_SYNC), F3(STP_ISEN_1),
F1(STP_ISEN_0), F2(PDM1_OUTDATA_128), F3(MSIOF2_SYNC),
F5(SIM1_VOLTSEL1), F1(TS_SPSYNC), F2(MSIOF7_RXD), F3(STP_ISSYNC_1),
F1(STP_ISSYNC_0), F2(PDM4_DATA_130), F3(MSIOF2_RXD),
F1(STP_OPWM_0), F5(SIM1_PWRON), F1(TS_SCK), F2(MSIOF7_SCK),
F3(STP_ISCLK_1), F1(STP_ISCLK_0), F2(PDM1_OUTCLK_133), F3(MSIOF2_SCK),
F5(SIM1_VOLTSEL0), F1(TS_SDAT), F2(MSIOF7_TXD), F3(STP_ISD_1),
F1(A10), F2(MMCD1_7), IRQ(31), /* Port192 */
F1(A9), F2(MMCD1_6), IRQ(32),
F1(A8), F2(MMCD1_5), IRQ(33),
F1(A7), F2(MMCD1_4), IRQ(34),
F1(A6), F2(MMCD1_3), IRQ(35),
F1(A5), F2(MMCD1_2), IRQ(36),
F1(A4), F2(MMCD1_1), IRQ(37),
F1(A3), F2(MMCD1_0), IRQ(38),
F1(A2), F2(MMCCMD1), IRQ(39), /* Port200 */
F1(A0), F2(BS),
F1(CKO), F2(MMCCLK1),
F1(CS4_N), F2(VIO_VD), F5(SIM1_GPO0),
F1(D9), F2(VIO_D9), F5(GIO_OUT9),
F1(D8), F2(VIO_D8), F5(GIO_OUT8),
F1(D7), F2(VIO_D7), F5(GIO_OUT7),
F1(D6), F2(VIO_D6), F5(GIO_OUT6),
F1(D5), F2(VIO_D5), F5(GIO_OUT5_217),
F1(D4), F2(VIO_D4), F5(GIO_OUT4_218),
F1(D3), F2(VIO_D3), F5(GIO_OUT3_219),
F1(D2), F2(VIO_D2), F5(GIO_OUT2_220), /* Port220 */
F1(D1), F2(VIO_D1), F5(GIO_OUT1_221),
F1(D0), F2(VIO_D0), F5(GIO_OUT0_222),
F1(RDWR_224), F2(VIO_HD), F5(SIM1_GPO2),
F1(RD_N), F1(WAIT_N), F2(VIO_CLK), F5(SIM1_GPO1),
F1(WE0_N), F2(RDWR_227),
F1(PWMO), F2(VIO_CKO1_229),
F1(SLIM_CLK), F2(VIO_CKO4_230), /* Port230 */
F1(SLIM_DATA), F2(VIO_CKO5_231), F2(VIO_CKO2_232), F4(SF_PORT_0_232),
F1(SLIM_DATA), F2(VIO_CKO5_231), F2(VIO_CKO2_232), F4(SF_PORT_0_232),
F2(VIO_CKO3_233), F4(SF_PORT_1_233),
F1(FSIACK), F2(PDM3_CLK_234), F3(ISP_IRIS1_234),
F1(FSIAISLD), F2(PDM3_DATA_235),
F1(FSIAOMC), F2(PDM0_OUTCLK_236), F3(ISP_IRIS0_236),
F1(FSIAOLR), F2(FSIAILR), F1(FSIAOBT), F2(FSIAIBT),
F1(FSIAOLR), F2(FSIAILR), F1(FSIAOBT), F2(FSIAIBT),
F1(FSIAOSLD), F2(PDM0_OUTDATA_239),
F1(FSIBOLR), F2(FSIBILR), F1(FSIBOMC), F3(ISP_SHUTTER1_242),
F1(FSIBOBT), F2(FSIBIBT), F1(FSIBOSLD), F2(FSIASPDIF),
F1(FSIBOBT), F2(FSIBIBT), F1(FSIBOSLD), F2(FSIASPDIF),
F2(SCIFB1_SCK_261), F7(CHSCIF1_HSCK), F2(SCIFB2_SCK_262),
F2(SCIFB1_SCK_261), F7(CHSCIF1_HSCK), F2(SCIFB2_SCK_262),
F1(SIM1_IO), F2(PDM2_DATA_281), F1(SIM1_CLK), F2(PDM2_CLK_282),
F1(SIM1_IO), F2(PDM2_DATA_281), F1(SIM1_CLK), F2(PDM2_CLK_282),
F1(SDHID2_0), F2(MSIOF4_TXD), F3(SCIFB2_TXD_295), F4(MSIOF6_TXD),
F1(SDHID2_2), F2(MSIOF4_RXD), F3(SCIFB2_RXD_297), F4(MSIOF6_RXD),
F1(SDHID2_3), F2(MSIOF4_SYNC), F3(SCIFB2_CTS_298), F4(MSIOF6_SYNC),
F1(SDHICLK2), F2(MSIOF4_SCK), F3(SCIFB2_SCK_299), F4(MSIOF6_SCK),
F1(SDHICMD2), F2(MSIOF4_SS1), F3(SCIFB2_RTS_300),
#define F2(x, y, z) F1(z, x, y)
.macro F2 b, c, d